עדיין מחפשים עבודה במנועי חיפוש? הגיע הזמן להשתדרג!
במקום לעבור לבד על אלפי מודעות, Jobify מנתחת את קורות החיים שלך ומציגה לך רק משרות שבאמת מתאימות לך.
מעל 80,000 משרות • 4,000 חדשות ביום
חינם. בלי פרסומות. בלי אותיות קטנות.
הצטרפו לצוות ההנדסה המוביל שלנו בחטיבת מערכות טילים וחלל, שם תהיו חלק בלתי נפרד מפיתוח מערכות פורצות דרך. אנו מחפשים מהנדס/ת וריפיקציה FPGA מוכשר/ת להשתלבות בפרויקטים מולטי-דיסציפלינריים מאתגרים.
תפקיד זה מציע הזדמנות ייחודית לעבוד בצוות פיתוח קטן ואיכותי, המתמחה בתכן לוגי ועיבוד אות. תהיו אמונים על הקמה והרצת סביבות וריפיקציה מתקדמות, תוך שימוש במתודולוגיות חדשניות ובטכנולוגיות מובילות בתחום.
תחומי האחריות:
- הקמה והרצה של סביבות וריפיקציה עבור רכיבים מתכנתים או מודולים, בגישת Random Based Verification.
- שימוש במתודולוגיות System Verilog UVM משלב ההגדרה ועד רמת Functional Coverage.
- תמיכה בסביבות וריפיקציה קיימות (Legacy) בשפות Verilog / VHDL / System Verilog.
- כתיבת סקריפטים ב-TCL וב-PYTHON.
- השתתפות פעילה בבדיקה ואימות התכן במעבדה וכתיבת מסמכי בדיקות.
- עבודה עם גורמים פנים וחוץ ארגוניים, כתיבת מפרט טכני ותמיכה בשילובים.
Requirements
- תואר ראשון בהנדסת חשמל ואלקטרוניקה - חובה.
- ידע מוכח בעיבוד אות ובקרה - חובה.
- לפחות 3 שנות ניסיון בווריפיקציית FPGA - חובה.
- ניסיון בכתיבת סביבות וריפיקציה עפ"י עקרונות Reuse ו-UVM - חובה.
- ביצוע אינטגרציה של סביבות וריפיקציה - חובה.
- מימוש ודיווח Functional Coverage - חובה.
- עבודה עם UVM scoreboard ו/או UVM Register Model - חובה.
- הכרות עם Assertion Based Verification - יתרון.
- הכרות טובה עם VIP's והטמעה בסביבת הווריפיקציה - יתרון.
- הכרות עם פרוטוקולי תקשורת (AXI, SPI, I2C, ETH, PCIe) - יתרון.
- ניסיון בתהליכי פיתוח תכן בשפות VHDL / Verilog - יתרון.
במקום לעבור לבד על אלפי מודעות, Jobify מנתחת את קורות החיים שלך ומציגה לך רק משרות שבאמת מתאימות לך.
מעל 80,000 משרות • 4,000 חדשות ביום
חינם. בלי פרסומות. בלי אותיות קטנות.